UART Register 정리

-SCRn(Serial Control Register 시리얼 제어 레지스터) : 송수신동작 및 송수신 클락 소스의 선택을 행하는 8비트 레지스터

-SSRn(Serial Status Register 시리얼 스테터스 레지스터) : SCI3의 스테터스 플래그와 송수신 멀티 프로세서 비트로 구성. TDRE, RDRF, OER, PER, FER은 클리어만 가능.

ESCRn(Extended Status/Control Reg.)

BGRHn(Baud Rate Generator Reg.)

SMRn(Serial Mode Register 시리얼 모드 레지스터) : 시리얼 데이터 통신 포멧 설정, 내장 보율 제너레이터의 클락 소스를 선택하기 위한 8비트 레지스터.

RDRn/TDRx(RX, TX Data Register)

ECCRn(Extended Comm.Contr. Reg.)

BGRLn(Baud Rate Generator Reg.)

ESIRn(Extended Serial Interrupt Reg.)

-RSR(수신 Shift 레지스터): 시리얼 데이터를 수신하기 위한 레지스터.

-RDR(수신 데이터 레지스터) : 1바이트의 데이터수신이 종료되면, 수신한 데이터를 RSP에서 RDR로 전송하여 수신동작 완료. 그 후 RSR은 수신 가능이 됨. RSR, RDR은 더블 버퍼로 이루어져 있으므로 연속된 수신동작 가능. RDR은 수신전용 레지스터이므로 CPU로부터 Write 안됨.

 

-TDR (송신 데이터 레지스터) : 송신 데이터를 저장하는 8비트 레지스터. TSR“Empty”를 검출하면 TDR에 기록된 송신데이터를 TSR로 전송하여 시리얼 데이터 송신을 시작. TSR의 시리얼 데이터 송신 중에 TDR에 다음 송신 데이터를 Write 해두면 연속송신 가능. TDR은 항상 CPU에 의한 Read/Write 가능

-TSR(송신 Shift Register) : 시리얼 데이터를 송신하기 위한 레지스터. TDR에서 송신 데이터를 일단 TSR로 전송, LSB(비트0)로부터 순서대로  TXD32단자에 송출함으로써 시리얼 데이터의 송신 수행. 1바이트 데이터를 송신하면 자동적으로 TDR에서 TSR로 다음 송신 데이터를 전송하여 송신을 시작. , TDR에 데이터가 기록되어 있지 않은(TDRE“1”dl 설정되어 있는) 경우, TDR에서 TSR로의 데이터 전송은 행하지 않음. CPU로부터 TSR을 직접 Read/Write 불가.


'업무 > 임베디드' 카테고리의 다른 글

와치독 타이머 16.01.11  (0) 2018.05.11
레지스터 용어 정리 15.06.15  (0) 2018.05.11
fujitsu mcu register 정리 15.06.12  (0) 2018.05.11
aligned access, unaligned access  (0) 2018.04.23
pan angle, tilt angle  (0) 2018.03.26

Crystal Clock : 4Mhz

CPU Clock : 56Mhz

PCLK1 : 14Mhz

PCLK2 : 14MHz


BGR2 = UART_BAUDRATE_115200; /*설명 : 보율레지스터 속도를 115200으로 지정 */ 

  • SCR2 = 0x17;     /*설명 :0001 0111 시리얼 컨트롤 레지스터 : 송수신동작 및 송수신 클락 소스의 선택을 행하는 8비트 레지스터

(PEN:0-> 패리티비트를 더하지 않음  P:1-> 패리티셋팅:짝수 가능 SBL:1-> 스탑비트길이:1비트 CL: 문자길이:8비트

AD:1-> 데이터비트 CRE:0->W만허용, 에러 발생시 에러플래그를 초기화한다 RXE:0->수신가능 TXE:0-> 전송가능)

 

  • SMR2 = 0x0D;    /*설명 :0000 1101 시리얼 데이터 통신 포멧 설정, 내장 보율 제너레이터의 클락 소스를 선택하기 위한 8비트 레지스터.                             (MD0: 셋팅을 비동기식 normal모드 OTO:0->1:1 외부클락인풋 가능(보율제너레이터 클락-리로드 C

LIN-USART 비트의 시리얼데이터출력 가능, 시리얼클락출력 불가능 또는 LIN-USART클락 INPUT PIN*, 소프트웨어 리셋 가능(Write), Read는 항상 0, 외부 시리얼클락소스 사용, 1:1 외부클락인풋 가능(보율제너레이터 클락-리로드 C), 오퍼레이션 모드 셋팅:비동기식 normal모드*/                                                                   

                                                               

                                                               

  • SSR2 = 0x00;     /*설명 :0000 0000                                                        

전송인터럽트 불가능, 수신인터럽트 불가능, LSB First /발신가능, 전송데이터저장레지스터:Full, 수신데이터레지스터:비어있음프레이밍에러없음, 오버런 에러없음, 패리티에러없음 */ 

  • SSR2_RIE = 1;     /*설명 : 수신인터럽트 가능 */   
  • SSR2_TIE = 0;     /*설명 : 전송인터럽트 불가능*/        
  • SSR2_TDRE = 1; /*설명 :전송데이터 레지스터: Full */
  • SSR2_RDRF = 0; /*설명 :수신데이터레지스터:Empty */

 

'업무 > 임베디드' 카테고리의 다른 글

와치독 타이머 16.01.11  (0) 2018.05.11
레지스터 용어 정리 15.06.15  (0) 2018.05.11
Fujitsu MCU UART Register 정리 15.06.12  (0) 2018.05.11
aligned access, unaligned access  (0) 2018.04.23
pan angle, tilt angle  (0) 2018.03.26

http://egloos.zum.com/wonchuri/v/2127834

'업무 > 임베디드' 카테고리의 다른 글

와치독 타이머 16.01.11  (0) 2018.05.11
레지스터 용어 정리 15.06.15  (0) 2018.05.11
Fujitsu MCU UART Register 정리 15.06.12  (0) 2018.05.11
fujitsu mcu register 정리 15.06.12  (0) 2018.05.11
pan angle, tilt angle  (0) 2018.03.26



pan angle, tilt angle


고정된 축을 중심으로 pan angle : 수평으로 회전하는 경우

tilt angle : 수직으로 회전하는 경우

'업무 > 임베디드' 카테고리의 다른 글

와치독 타이머 16.01.11  (0) 2018.05.11
레지스터 용어 정리 15.06.15  (0) 2018.05.11
Fujitsu MCU UART Register 정리 15.06.12  (0) 2018.05.11
fujitsu mcu register 정리 15.06.12  (0) 2018.05.11
aligned access, unaligned access  (0) 2018.04.23

+ Recent posts